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Atualmente, mais e mais eletrodomésticos estão mudando do acesso discado de baixa velocidade à Internet para o acesso à Internet de banda larga ou Internet Protocol Television (IPTV), especialmente a expectativa é que a IPTV alcance um rápido desenvolvimento na China. Em comparação, o custo de infraestrutura de IPTV é bastante baixo, porque este método não requer cabos de cobre, mas usa DSL ou links de banda larga e decodificadores para transmitir programas para eletrodomésticos.
Os FPGAs (programmable gate arrays) atuais provaram ser a escolha ideal para tais plataformas, pois fornecem flexibilidade para mudar rapidamente os requisitos do mercado. Os requisitos de energia dos FPGAs geralmente são muito complexos, porque os FPGAs têm até três requisitos de energia. Para obter um desempenho confiável do sistema, esses requisitos devem ser sequenciados.
Tensão do núcleo
O barramento de tensão do núcleo geralmente é definido como VCCINT para alimentar a lógica FPGA. A corrente necessária varia de centenas de miliamperes a dezenas de amperes, dependendo da frequência do clock e do número de portas usadas. Como a carga é altamente capacitiva, a tensão do núcleo e os requisitos de corrente podem ser muito altos no início. O núcleo do FPGA possui requisitos rígidos para resposta a transientes. A tensão da fonte de alimentação do núcleo deve aumentar lentamente e muitas vezes é necessário aumentar para uma tensão estável dentro de um período de tempo fixo. Por exemplo, o Virtex-4 da Xilinx deve permitir que a fonte de alimentação VCCINT ligue entre 0.2 ms e 50 ms.
Tensão de E / S
A tensão de E / S (VCCIO) geralmente requer um trilho de tensão de 3.3 V, 2.5 V, 1.8 V ou 1.5 V. O padrão de E / S pode ser definido de forma independente pelo módulo de E / S no FPGA, portanto, um FPGA pode ter mais de uma tensão de E / S. O requisito de corrente de E / S depende do número de E / S usados e da velocidade do clock. Geralmente, os requisitos de corrente de E / S são baixos, variando de algumas centenas de mA a 3A.
Tensão auxiliar
A tensão auxiliar (VCCAUX) requer que a fonte de alimentação tenha uma alta taxa de rejeição da fonte de alimentação (PSRR) porque a fonte de alimentação está diretamente conectada ao gerenciamento de relógio digital (DCM). Se o ruído da fonte de alimentação se acoplar ao DCM, isso pode afetar o desempenho do sistema.
Embora as tensões de E / S e auxiliares não precisem ser energizadas em uma ordem específica, os fabricantes de FPGA geralmente especificam ou rastreiam a seqüência de inicialização do núcleo e da E / S. As consequências de não especificar a seqüência de inicialização ou rastrear a seqüência de inicialização são geralmente danos irreparáveis aos dispositivos no sistema. FPGAs, PLDs, DSPs e microprocessadores geralmente colocam diodos entre o núcleo e a fonte de alimentação de E / S como componentes de proteção ESD. Se a fonte de alimentação violar os requisitos de rastreamento e exceder a polarização direta do diodo de proteção, o dispositivo pode ser danificado.
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solução
Para ilustrar a complexidade dos requisitos da fonte de alimentação FPGA, tome o requisito de ligar o VCCINT em um período de tempo fixo como exemplo. Para garantir o tempo de inicialização entre 2ms e 50ms controlado pelos limites superior e inferior, o circuito mostrado na Figura 1 deve ser implementado.
Figura 1: MIC37302 e circuitos discretos garantem inclinação e tempo controlados
A seqüência de inicialização ou o rastreamento da seqüência de inicialização do núcleo e das fontes de alimentação de E / S aumenta a complexidade e o custo do circuito de gerenciamento de energia. Para superar esse problema, os engenheiros de projeto precisam de um dispositivo que atenda a todas essas necessidades sem adicionar componentes externos. Um exemplo deste produto é o MIC68200 LDO da Micrel, que é adequado para várias fontes de alimentação on-board. Ele integra funções como controle de velocidade crescente, sequenciamento de inicialização e rastreamento em um pacote MLF 3 × 3mm.
Vários MIC68200s podem ser conectados em cascata em dois modos: no modo de rastreamento, a saída do dispositivo mestre aciona o pino RC do dispositivo escravo para que o dispositivo escravo possa rastrear o regulador mestre durante a ativação e desativação; no modo de inicialização sequencial, o mestre O POR do dispositivo aciona a extremidade habilitada (EN) do dispositivo escravo para que seja ligado após o dispositivo mestre ser ligado e desligado antes (ou depois) do dispositivo mestre está desligado. Além dos recursos de rastreamento, o pino de controle de rampa de tensão (RC) também pode programar com precisão a tensão de rampa do trilho de tensão do núcleo por meio de um capacitor.
Os circuitos de rastreamento e classificação são mostrados na Figura 2 e na Figura 3, respectivamente. Pode-se ver na figura que a solução é simples e requer poucos componentes discretos.
Figura 2: Circuito de rastreamento, a inclinação da tensão do núcleo é definida pelo capacitor no pino RC
Figura 3: Circuito de sequenciamento, o POR do regulador mestre habilita o regulador escravo e o atraso do POR é definido pela baixa capacitância
Resumo deste artigo
Resumindo, as vantagens de usar FPGA como plataforma de codificação e decodificação na transmissão de vídeo IPTV são óbvias. No entanto, alimentar o FPGA pode ser um desafio, e o uso de dispositivos dedicados de gerenciamento de energia projetados de acordo com os requisitos de energia, como o MIC68200, reduzirá muito o tempo de comercialização de novos sistemas.
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